设计一个组合逻辑电路,用于判别以8421码表示的1位十10进制转8421数是否为合数

一、单项选择题(本大题共15小题每小题2分,共30分)

(在每小题列出的四个备选项中只有一个是最符合题目要求的请将其代码填写在题后的括号内。错选、多选或未选均无分)

2.8线—3线优先编码器的输入为I 0—I 7 ,当优先级别最高的I 7有效时其输出012Y Y Y ??的值是( )。

3.十六路数据选择器的地址输入(选择控制)端有( )个

4. 有一个左移移位寄存器,当预先置入1011后其串行输入固定接

0,在4个移位脉冲CP 作用下四位数据的移位过程是( )。

6. 一只四輸入端或非门使其输出为1的输入变量取值组合有

7. 随机存取存储器具有( )功能。

}

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