CMOS传输门实现门电路实现问题

点击联系发帖人 时间：2018-06-30 02:02

门电路实现

CMOS与非门电路实现的输入端悬空时昰高电平还是低电平 [问题点数：40分结帖人mhx117]

自己看了下CMOS与非门的原理电路，感觉悬空后看不出MOS管是否导通求助。因为我看到一个CMOS与非门嘚输入端是另一个CMOS三态门的输出端而这个CMOS三态门是处于高阻抗状态（相当于断开）

自己回复个，先去吃饭

吃完回来仔细看了下题，发現题中画的与非门不是普通CMOS与非门而是OD与非门。但是OD与非门的输入端也不像是可以悬空的样子...

一般的CMOS芯片在输入悬空的情况下状态不定可能是1,也可能是0,还有可能来回变化，所以对于可能悬空的输入都要加一个上拉或者下拉电阻来避免这种情况出现。

简化下问题：CMOS三态門的高阻态输出接入OD门时视为高电平还是低电平？为什么。CMOS逻辑门的输入端不能悬空但是三态门的高阻态相当于断开，断开岂不是懸空了么

确实CMOS门电路实现输入端不可悬空。那么三态门的高阻抗状态接OD输入端看作是高是低还是其他

一般OD门作为输入的话，是呈现高阻的外部如果没有驱动电平，内部也没有上拉的话我认为应该是0的。

但一般设计的时候都会根据具体手册看这种输入是否加上拉。

輸入需要上拉会下拉否则有可能出现功耗过大的现象，我原来遇到过

OD与非门，输入端还是一样的CMOS输入端可看作一个小容量电容，电嫆充到一定电压输入为1，电容放到一定电压输入为0，如果悬空电容内的电荷会因各种寄生元件影响而不可预知的充放电，甚至可能高频率的来回振荡造成芯片发热，就像9楼说的那样

OD与非门，输入端还是一样的CMOS输入端可看作一个小容量电容，电容充到一定电压輸入为1，电容放到一定电压输入为0，如果悬空电容内的电荷会因各种寄生元件影响而不可预知的充放电，甚至可能高频率的来回振荡造成芯片发热，就像9楼说的那样

原来如此~明白CMOS门电路实现不能悬空的道理了。

但是解答好像跟我问题本意跑偏了的样子~我能直接上圖问下么？

如果左边两个与非门是TTL芯片那么F2悬空视为高电平，如果是CMOS芯片F2视为未知电平。

如果左边两个与非门是TTL芯片那么F2悬空视为高电平，如果是CMOS芯片F2视为未知电平。

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